时序图违规，为什么硬件调试仍然能得出正确结果

来源：蜘蛛抓取(WebSpider) 时间：2015-10-26 09:02 标签： 硬件时序图
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fpga不做时序约束会不会出现时序违规
请教各位，如果我没有做任何的时序约束，编译通过了，是不是意味着我的寄存器没有出现时序违规，即都满足setup和hold时间，还是他即使出现了时序问题，也不会提示报错。cpld/fpga在调试时,为什-中国学网-中国IT综合门户网站
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cpld/fpga在调试时,为什
来源：互联网 发表时间： 3:01:29 责任编辑：鲁晓倩字体：
为了帮助网友解决“cpld/fpga在调试时,为什”相关的问题，中国学网通过互联网对“cpld/fpga在调试时,为什”相关的解决方案进行了整理,用户详细问题包括:RT,我想知道:cpld/fpga在调试时,为什么电路板还在运行上次程序的结果，具体解决方案如下：解决方案1：
没有清零。或者程序设计者要求运行上一程序后，才能进入新的运行。
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时序违规，为什么硬件调试仍然能得出正确结果
我有更好的答案
希望我的回答对你有所帮助，需要硬件也支持，Keil并不是支持所有芯片的提示楼主想要调试哪块板子，但是IAP15F2K61S2就支持在线仿真，如果满意请设置为最佳答案，举个例子STC12C5A60S2就不支持在线仿真（调试）
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