一个具有14根地址线和8位数据线的存储器能存储多少字节的信息?_汇编吧_百度贴吧
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一个具有14根地址线和8位数据线的存储器能存储多少字节的信息?收藏
具体点儿，那个8位数据线怎么回事儿?
8位数据线说明机器字长是8位，也就是一个字节
听说来玩的都领了T豆！
14根地址线，经过译码器译码以后可以选中2^14个字单元，本机中数据线8根说明一个字单元包含一个字节，所以可以存储2^14个字节即16k
大侠，一个字怎么包含一个字节呢，求解释.......
这个题属于计算机组成原理的范畴，在计算机组成原理中一个字可以包含n个字节（n&=1）。通常我们说的字是狭义上的字，n=2。这个不必深究，知道怎么回事就行
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用1024×1位的RAM芯片组成16K×8位的存储器，需要多少个芯片?分为多少组?共需多少根地址线?地址线如何分配?试
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用1024×1位的RAM芯片组成16K×8位的存储器，需要多少个芯片?分为多少组?共需多少根地址线?地址线如何分配?试画出与CPU的连接框图。
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某半导体存储器有8根数据线，13根地址线，则它的存储容量是()A．8K×8位B．16K×8位C．32K×8位D．64K×8位
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某半导体存储器有8根数据线，13根地址线，则它的存储容量是 ( )A．8K×8位B．16K×8位C．32K×8位D．64K×8位请帮忙给出正确答案和分析，谢谢！
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图形验证：一个16k*32位的存储器，其地址线和数据线的总和是_百度知道
一个16k*32位的存储器，其地址线和数据线的总和是
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出门在外也不愁编址，试画出主存字地址和字节地址的分配情况。
7．一个容量为16K?32位的存储器，其地址线和数据线的总和是多少？当选用下列不同规格的存储芯片时，各需要多少片？
1K?4位，2K?8位，4K?4位，16K?1位，4K?8位，8K?8位
8．试比较静态RAM和动态RAM。
9．什么叫刷新？为什么要刷新？说明刷新有几种方法。
10．半导体存储器芯片的译码驱动方式有几种？
11．画出用1024?4位的存储芯片组成一个容量为64K?8位的存储器逻辑框图。要求将64K
①分成4个页面，每个页面分16组，指出共需多少片存储芯片。
12．设有一个64K?8位的RAM芯片，试问该芯片共有多少个基本单元电路（简称存储基元）？
欲设计一种具有上述同样多存储基元的芯片，要求对芯片字长的选择应满足地址线和数据线的总和为最小，试确定这种芯片的地址线和数据线，并说明有几种解答。
13．某8位微型机地址码为18位，若使用4K?4位的RAM芯片组成模块板结构的存储器，
（1）该机所允许的最大主存空间是多少？
（2）若每个模块板为32K?8位，共需几个模块板？
（3）每个模块板内共有几片RAM芯片？
（4）共有多少片RAM？
（5）CPU如何选择各模块板？
14．设CPU共有16根地址线，8根数据线，并用MREQ（低电平有效）作访存控制信号，
RW作读写命令信号（高电平为读，低电平为写）。现有下列存储芯片：
ROM（2K?8位，4K?4位，8K?8位），
RAM（1K?4位，2K?8位，4K?8位）
及74138译码器和其他门电路（门电路自定）。
试从上述规格中选用合适芯片，画出CPU和存储芯片的连接图。要求：
（1）最小4K地址为系统程序区，地址范围为用户程序区；
（2）指出选用的存储芯片类型及数量；
（3）详细画出片选逻辑。
15．CPU假设同上题，现有8片8K?8位的RAM芯片与CPU相连，试回答：
（1）用74138译码器画出CPU与存储芯片的连接图；
（2）写出每片RAM的地址范围；
（3）如果运行时发现不论往哪片RAM写入数据后，以A000H为起始地址的存储芯片
都有与其相同的数据，分析故障原因。
（4）根据（1）的连接图，若出现地址线A13与CPU断线，并搭接到高电平上，将出
现什么后果？
16．反映主存和外存的速度指标有何不同？
17．某机字长16位，常规的存储空间为64K字，若想不改用其他高速的存储芯片，而使访
存速度提高到8倍，可采取什么措施？画图说明。
18．什么是“程序访问的局部性”？存储系统中哪一级采用了程序访问的局部性原理？
19．计算机中设置Cache的作用是什么？能不能把Cache的容量扩大，最后取代主存，为什
20．Cache做在CPU芯片内有什么好处？将指令Cache和数据Cache分开又有什么好处？
21．设某机主存容量为4MB，Cache容量为16KB，每字块有8个字，每字32位，设计一
个四路组相联映象（即 Cache 每组内共有4个字块）的Cache组织，要求：
（1）画出主存地址字段中各段的位数；
（2）设Cache的初态为空，CPU依次从主存第0、1、2、…… 99号单元读出100个字（主存一次读出一个字），并重复按此次序读8次，问命中率是多少？
（3）若Cache的速度是主存的6倍，试问有Cache和无Cache相比，速度约提高多少
① 将存储器分成若干个容量相等的区域，每一个区域可看作一个页面。
22．简要说明提高访存速度可采取那些措施？
23．画出NR、NRZ、NRZ1、PE、FM写入数字串1011001的写入电流波形图。
24．以写入为例，比较调频制和改进调频制的写电流波形图。
25．画出调相制记录的驱动电流、记录磁通、感应电势、同步脉冲及读出代码等
几种波形。
26．磁盘组有六片磁盘，每片有两个记录面，存储区域内径22cm，外径33cm，道密度为
40道/cm，内层密度为400 位/cm，转速2400 转/分，问：
（1）共有多少存储面可用？
（2）共有多少柱面？
（3）盘组总存储容量是多少？
（4）数据传输率是多少？
27．某磁盘存储器转速为3000转/分，共有4个记录盘面，每毫米5道，每道记录信息12288
字节，最小磁道直径为230mm，共有275道，求：
（1）磁盘存储器的存储容量；
（2）最高位密度（最小磁道的位密度）和最低位密度；
（3）磁盘数据传输率；
（4）平均等待时间。
28．磁表面存储器和光盘存储器记录信息的原理有何不同？
29．试从存储容量、存取速度、使用寿命和应用场合方面比较磁盘、磁带和光盘存储器。
30．写出、对应的海明码。
（1）按配偶原则配置；
（2）按配奇原则配置。
31．已知接受到的海明码（按配偶原则配置）为00，1100001，
检查上述代码是否出错？第几位出错？
32．已知接收到下列海明码，分别写出它们所对应的欲传送代码。
1100000（按偶性配置）；
1100010（按偶性配置）；
1101001（按偶性配置）；
0011001（按奇性配置）；
1000000（按奇性配置）；
1110001（按奇性配置）；
33．欲传送的二进制代码为1001101，用奇校验来确定其对应的海明码，若在第六位出错，
说明它的纠错过程。
34．为什么海明码纠错过程中，新的检测位P4P2P1的状态即指出了编码中错误的信息位？
35．设有效信息为1100，试用生成多项式G(x) = 1011，将其编成循环冗余校验码。
36．有一个（7，4）码，其生成多项式G(x)= x3 + x + 1，写出代码1001的循环冗余校验码。
第四章 存储器习题部分答案
主存：与CPU直接交换信息，用来存放数据和程序的存储器。
辅存：主存的后援存储器，用来存放当前暂时不用的程序和数据，不予CPU直接交换信息。
CACHE：为了解决CPU和主存的速度匹配，提高访存速度的一种存储器，它设在主存与CPU间，起缓冲作用。
RAM：可读可写存储器，是随机存取的，在程序执行过程中既可读出也可写入，而且存取时间与存储单元所在位置无关。
SRAM：静态RAM，以触发器原理寄存信息。
DRAM：动态RAM，以电容充放电原理寄存信息。
ROM：只能对其存储的内容读出，而不能对其写入的只读存储器。
PROM：可实现一次性编程的只读存储器。
EPROM：可擦洗可编程的只读存储器，用紫外线照射进行擦写。
EEPROM：用电气方法进行擦写的可擦洗可编程的只读存储器。
CDROM：只读型光盘，此中光盘内数据程序由厂家事先写入，用户只能读出，不能修改或写入新的内容。
Flash Memory：快擦型存储器，是性能价格比号，可靠性高的可擦写非易失型存储器。
计算机中有以下部件可以存储信息：寄存器、缓存、主存、磁盘、磁带等。
速度上：寄存器&缓存&主存&磁盘&磁带
容量上：寄存器&缓存&主存&磁盘&磁带
价格/位：寄存器&缓存&主存&磁盘&磁带
(1) 存储器的层次结构主要体现在：缓存－主存和主存－缓存这两个存储层次上。
(2) 从CPU的角度来看，缓存－主存这一层次的速度接近于缓存，高于主存，其容量和位价却接近于主存。从主存－缓存这一层次，其速度接近于主存，容量接近辅存，平均位价也接近于辅存，从而解决了速度、容量、成本这三者间的矛盾。
(3) 主存与缓存之间的数据调动是由硬件自动完成的，CPU不能直接访问辅存，辅存只能与主存交换数据，他们之间的信息调动均由硬件和操作系统来实现。
存取周期：是指存储器进行连续两次独立的存储器操作（如连续两次读操作）所需的最小间隔时间。
存取时间：是指启动一次存储器操作（读或写）到完成该操作所需的全部时间。 由概念可知，这两个概念是有很大区别的，通常存取周期大于存取时间。
(1) 存储器带宽：每秒从存储器进出信息的最大数量。
(2) 带宽＝32bit/200ns＝160M位/秒
因为容量为16K×32，所以需地址线14根，数据线32根，总和是46根。
需要128片1K×4，32片2K×8，32片4K×4，32片16K×1，16片4K×8，8片8K×8
静态RAM是触发器存储信息，因此即使信息读出后，它仍保持其原状态，不需要在城，但电源掉电时，原存信息丢失。动态RAM靠电容存储电荷的原理来寄存信息，即使电源不掉电，信息也会自动消失。
动态RAM的优点：
① 在同样大小的芯片中，动态RAM的集成度远高于静态RAM，如动态RAM的基本单元电路为一个MOS管，静态RAM的基本单元电路为六个MOS管；② 动态RAM行、累地址按先后顺序输送，减少了芯片引脚，封装尺寸也减少；③ 动态RAM的功耗仅为静态RAM的1/6；动态RAM的价格仅为静态RAM的1/4
动态RAM的缺点：
① 由于使用动态元件，因此他的速度比静态RAM低；② 动态RAM需要再生，故需配置再生电路，也需要消耗一部分功率。
(1) 见下图
(2) 第一片0000H~1FFFH，第二片2000H~3FFFH，??，第八片E000H~FFFFH
(3) 说明译码器有误，第六根线的输出始终是0。
配奇：10，0010111
配偶：10，1111111
位错，位错，位错，位错
1100000欲传送代码是0欲传送代码是1欲传送代码是0001， 0011001欲传送代码是0欲传送代码是1欲传送代码是1001