求74LS148优先编码器74ls147的逻辑图

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设计逻辑电路用4位全加器74LS283完成4位余3码的全加器,可增加门电路或中规模器件实现电路,如编码器74LS148、
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设计逻辑电路用4位全加器74LS283完成4位余3码的全加器,可增加门电路或中规模器件实现电路,如编码器74LS148、数据选择器74LS151、译码器74LS138、4位全加器74LS283,所用器件数不限。
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