quartus 15 生成fft ip核,编译通过,在quartusii破解中调用modelsim仿真的时出现了错误:请高手指点一下

&&&&quartus11.0 FFT
IP核的实现 modelsim仿真通过
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quartus中调用modelsim仿真,测试脚本中只有输入输出信号,添加某些中间变量后,发现其输出波形一直为X
来源:互联网 发表时间: 0:57:31 责任编辑:李志喜字体:
为了帮助网友解决“quartus中调用modelsim仿真,测试脚本中只有输入输出信号,添加某些中间变量后,发现其输出波形一直为X”相关的问题,学网通过互联网对“quartus中调用modelsim仿真,测试脚本中只有输入输出信号,添加某些中间变量后,发现其输出波形一直为X”相关的解决方案进行了整理,用户详细问题包括:RT,我想知道:quartus中调用modelsim仿真,测试脚本中只有输入输出信号,添加某些中间变量后,发现其输出波形一直为X,具体解决方案如下:解决方案1:这些中间变量添加到测试脚本的路径是不是有问题,仔细检查一下,最好从源头一点点查看。找到出问题的地方
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<a href="/cse/search?q=关于quartus生成IP核的仿真出错问题的解决
> 关于quartus生成IP核的仿真出错问题的解决
关于quartus生成IP核的仿真出错问题的解决
对MegaCore的从头至尾操作了一遍,说实话很是复杂,不过,大家都知道的可以直接拿来用的,大大节省了开发时间,而且其代码是绝对优化的;所有的前奏都操作成功,设置没什么,开始对的fft.vhd文件进行编译,点击Start Compilation,第一感觉:慢!编译很慢,应该是文件太庞大了吧,需要很多信息,在Status里观察进度,Full Compilation进行至80%,报错!本文引用地址:无奈,但没能通过EDA Netlist Writer,查找错误信息,简单六行:主要错误:Error:Can''t generate netlist outout files because the fileC:/altera/72/ip/fft/lib/auk_dspip_math_pkg_fft_72.vhd is an OpenCore Plus time-limited file.生成网表输出文件。OpenCore Plus time-limited ,在之前进行的一系列设置里(settings)ENA Netlist Writer options里选择的是第三方软件modelsim,缘故就出在此。在没有授权时opencore是不允许生成Netlist的,更改设置:settings里EDA Tool Settings &&Simulation选择&none&,重新编译,通过。接下来,理清管脚关系,进行。
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