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查询表look up table 用verilog怎么写呢?最好能给个代码!
不能用Verilog语言RTL级描述出来,但是可以用原语例化它.以Xilinx公司的Virtex FPGA器件为例,以Verilog语言例化.在Xilinx的原语里,有LUT,LUT_D,LUT_L三种类型的查找表原语,而每一个又分1,2,3,4四种输入形式(现在已经有4以上的了).这里就以普通的四输入查找表LUT4为例吧:LUT4 LUT4_inst (.O(O),// LUT general output.I0(I0),// LUT input.I1(I1),// LUT input.I2(I2),// LUT input.I3(I3),// LUT input);
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