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Warning (292000): FLEXlm software error: Invalid (inconsistent) license key. The license key and data for the feature do not match. This usu
这里输入是00101输出是，输入1输出00，11交替，输入0输出01，怎么也看
每次到这里就卡住了
如题，请问哪位大神知道怎么解决吗？
用LAM模块画了一个智能函数发生器的原理图，编译没有错误，用quartus ii 9.0自带的逻辑分析仪就是出不来正
精通verilog和vhdl，成功指导众多学生完成课程设计和毕业设计，例如万年历，计算器，cpu，dds，fir，图像处
老师给我了他以前做的原理图，仿真后结果这样，图肯定是没问题的，网上百度了下，说是不是破解的问
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非诚勿扰！！！ 谢谢
行还多了个txt的后缀 运行不了 求助！！！在线等
本吧竟然没有quartus软件的下载地址，实在失望，还好网上找到了一个，在此分享下，方便需要的同学
新手刚自学啊，找不出原因求大神指点几句，第一个是仿真完得到的波形图，第二张就是我关闭文件后再
求大神帮忙，出现下面这个之后就不知道干嘛了，哪看输出波形啊？
倍频后时钟有延时，这个该怎么设置？
大四学生 刚学这个软件 在做智能交通系统 做了个普通的交通灯 还没有进行优化智能，有没有老哥可以帮
二。交通灯控制器 1. 可设定亮灯时间 2. 数码显示
精通FPGA（ISE/QII，Verilog/VHDL，MODELSIM)，,还有基于FPGA的通信领域系统，调制解调系统，抗多径系统，数据链路，锁相环，延迟锁定环，平方环，OFD
编译通过之后点分配管脚，然后报错闪退 然而昨天运行同一个代码时还是好好的 这种情况咋解决...
可以仿真成功，点open可以打开波形，但点report整个页面就卡住了！怎么办QAQ？
declaring global objects is a systemverilog feature 这个错误该怎么改 求帮助求帮助呀！
求quartus安装包
Error (199014): Vector source file C:/Users/jiaming/Desktop/project/Waveform.vwf specified with --testbench_vector_input_file option does no
求助呀，大家有没有碰到过quartus2 Mega wizard窗口 大小不可调的情况？如图，真困惑，next点不到，真他妈服
刚学quartus，老师布置了作业不会额，求大神指导。0~9999计数器程序~感激
quartus ii 9.1有人会破解吗，为啥我在安装文件夹里没找见90|91这两个文件夹
quartus创建项目展示不可以打开项目，是什么情况啊？
到底兼容不？
开始进quartus选择了30天试用，按教程破解完，也不知道有没有成功，试了一下可以编译原理图，看哪里可
就是这个sel，怎么改啊？我找了半天没找到
vhdl里面的real数据类型，综合时无法通过，但是又必须用到实数，这个怎么办？
百度半天也没找到
如图 用的是quartus8.1 win10 求问该怎么解决
求问quartus中的传输门符号
use ieee.std_logic_1164. use ieee.std_logic_unsigned. entity clklift is port(clk: in std_ clk_2: out std_
实验课需要编几个简单的图，需要输出波形，一点simulation就成这样了
总是卡在99%，系统为win10 14342，求大神解决
Error (10500): VHDL syntax error at controllift.vhd(170) near text &when&; expecting &end&, or &(&, or an iden
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Quartus&II&9.0的简单应用
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Quartus&II&9.0的简单应用
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下面将创建一个LED流水灯来演示工程文件的创建过程，假定您已经安装好了Quartus II 9.0软件，Quartus II 9.0的安装请阅光盘的安装教程。
1、 双击桌面quartus II 图标，如下图所示，启动Quartus II 软件。
2、 打开后软件界面如下图所示：
3、 开始新建一个工程，点击【File&New Project Wizard】使用向导创建工程，如下图所示：
4、 启动项目向导，如下图所示，点击 【Next】按钮进入下一步。
5、 进行项目文件位置、名称及顶层实体名称的设置，如下图所示：
6、 下面我们用一个底板上的16位LED实验作为实例。如下图所示：
7、 设置好名称和项目位置后点击 【Next】 按钮,进入下图所示界面，这里我们可以将已经写好的文件添加进来。
8、 这里我们将已经写好的led_b.v 添加进来，点击【 File name：】后面的【…】按钮，添加【D:\EP1C12_D\LED_EX\sour\led_b.v】文件，如下图所示：
9、 找到led_b.v后如下图所示，点击【 Add…】按钮将led_b 文件添加到项目中。
10、 添加好文件后点击【Next】进入下一步，选择芯片型号，这里我们选择与开发板对应的芯片：EP1C6Q240C8或EP1C12Q240C8，如下图所示：
11、 点击【 Next】进入下一步,按默认的综合、仿真和时序分析工具即可，点击【Next】按钮入下一步:
12、 全部设置好后会出现一个设置总揽，如下图所示，点击【 Finish】结束向导，如下图：
13、 设置完后进入QuartusII 界面，如下图所示：
14、接下来尚需进行一些设置，在左侧的芯片名称上点右键选择【 Device…】对芯片的一些属性进行设置，如下图所示：
15、打开设置界面后点击 【Device & Pin Options…】 按钮，如下图：
16、打开 【Device & Pin Options】界面后找到【 Unused Pins】选项卡，可以看到默认设置下，没有使用到的管脚是作为输出下拉到地的，这里需要修改为作为高阻态或者叫三态输入，这样才不会影响到外部逻辑。
17、点击下拉列表选择【 As input tri-stated】，如下图，将未使用的管件全部设为输入高阻态。
18、设置好后如下图所示，点击 【确定】 按钮确认修改。
19、回到【Settings】界面后，如下图所示，其余设置均无需修改，点击 【OK】按钮确认，退出设置。
20、回到Quaruts 主界面，点击中间的文件列表项，可以看到，我们之前添加的文件 led_b.v 已经在文件列表里面，可以打开直接修改。在这里还可以添加/删除文件。 module led_b(clk,reset_n,led,dig); //底板的16位流水灯的程序 input clk,reset_n;
output [15:0] //输出的16位的LED灯 output [7:0] //输出到八位数码管的位选 reg [15:0] //定义LED延时的计数器 reg [31:0]
assign dig=8' //关闭数码管
always@(posedge clk or negedge reset_n)
if(!reset_n) //异步复位
led&=16'b11_1110; //复位是16位LED的状态 end else if(cnt!=4000000)
cnt&=cnt+1; else begin
led[15:1]&=led[14:0];
led[0]&=led[15]; //LED数据的向左位移，形成流水灯 cnt&=0;
led_b 就是实体名，跟文件名要同名。
21、编写好程序文件后或者导入程序文件后需要先编译一次看是否有语法或者逻辑错误，点击 开始编译，如果有错则需要进行修改，如果程序没错，将会弹出编译后的一些信息，如使用了多少逻辑门，占用了多少资源等，可以根据此信息来选择适合的芯片来设计相关的产品，如下图所示：
22、语法编译通过后就可以对管脚进行分配了，点击按钮进入 Assignment Editor 界面，将输入与输出分配到相应的管脚，如下图所示：
也可以根据我们提供的TCL文件自动分配引脚。
23、管脚分配完成后还需要进行编译，点击再次进行编译，提示是否需要保存修改后的管脚分配，点击【 是 】按钮保存修改，如果没有错误则可以顺利编译并显示资源使用信息。
24、编译成功后接下来需要将编译好的文件下载到目标板进行验证，点击 Programmer 按钮，如果没有选择下载线的类型则会提示 No Hardware,如下图：
25、点击 【Hardware Setup…】按钮进行下载线的选择，如下图所示，这里可以选择 USB-Blaster 下载线【使用USB 接口】或者是ByteBlaster 下载线【使用并口来下载】，如下图所示：
注意：首次使用USB 下载线之前需要先安装驱动程序，USB 下载线驱动安装请参考光盘里面的相关教程。
26、这是需要将下载线连到板子的JTAG 口并给板子上电，并在下载选项里面 Program/Configure 打钩，点击【Start】开始下载，下载过程有进度条可以显示。
27、下载成功后如下图所示：
28、验证：程序下载成功后，我们会看到底板上的LED1―LED15依次亮起。说明程序编写和下载成功！
29、进一步的学习请研究光盘的范例和quartusII 软件操作方面的指导，或者是VHDL 或者是Verilog 语言教程。
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