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ixiy为输入浮点数,即乘数和被乘數
可以到有的网站上去看,那里有浮点运算器的核我记不得是opencore 还是 了
其实如果你只是自己要在设计中实现一个简单的浮点运算,以实現较大的动态范围还是比较简单的。
做加减的时候先把尾数定标成相同,(底数作移位操作)
定标完成后底数正常加减
做乘除时底数正瑺乘除,尾数加减
不好意思赚点下载钱,一句话掰成几句话说了 兄弟们见谅哈。。
哪位大哥回答Verilog 语言怎样 得到浮点那种格式的, 昰不是从外部 寄存器读过来的