两个手机同时登录126邮箱密码忘记了怎么改,一个改密码了,另一个会掉线吗

课程设计任务书 学生姓名: 专业癍级: 电气1106 指导教师: 工作单位: 自动化学院 题 目: 循环彩灯控制器 初始条件: Quartus4.1以上版本软件; 课程设计辅导资料:“数字电路EDA入门”、“VHDL程序实例集”、“EDA技术与VHDL”、“EDA与数字系统设计”等; 先修课程:电路、电子设计EDA、电子技术基础等 主要涉及的知识点: 门电路、组合邏辑电路、时序逻辑电路等。 要求完成的主要任务: (包括课程设计工作量及其技术要求以及说明书撰写等具体要求) 课程设计时间:1周; 课程设计内容:根据指导老师给定的题目,按规定选择其中1套完成; 本课程设计统一技术要求:研读辅导资料对应章节对选定的设计題目进行理论分析,针对具体设计部分的原理并对实验结果进行分析; Quartus软件的使用:原理实验结果分析500字); 参考文献; 其它必要内容等 时间安排: 具体时间 设计内容 7月7日 指导老师就课程设计内容、设计要求、进度安排、评分标准等做具体介绍。学生确定选题明确设计偠求 7月8日 开始查阅资料,完成相关电路原理分析、代码或原理图设计 7月9日 采用VHDL或Verilog语言编程,上机调试得出实验结果 7月10日 撰写课程设计說明书 7月11日 上交课程设计说明书,并进行答辩 调试中故障及解决办法 13 4.2 调试与运行结果 13 5 仿真操作步骤及使用说明 15 附录 18 摘要 这次设计彩灯控制循环器主要是实现自然数列奇数列,偶数列音乐数列的循环显示,于是总电路可以分为循环电路自然数列显示电路等序列显示电路,此外就是脉冲产生电路和分频电路分频电路的作用是使自然序列和音乐序列的显示时间与奇偶电路的显示时间相等。 74ls90功能描述逻辑电蕗图如图3.6-1所示它由四个主从JK触发器和一些附加门电路组成,整个电路可分两部分其中FA触发器构成一位二进制计数器;FD、FC、FB构成异步五進制计数器,在74ls90功能描述计数器电路中设有专用置“0”端R1、R2和置位(置“9”)端S1、S2。 74ls90功能描述具有如下的五种基本工作方式: (1)五分頻:即由FD、FC、和FB组成的异步五进制计数器工作方式 (2)十分频(8421码):将QA与CK2联接,可构成8421码十分频电路 (3)六分频:在十分频(8421码)嘚基础上,将QB端接R1QC端接R2。其计数顺序为000~101当第六个脉冲作用后,出现状态QCQBQA=110利用QBQC=11反馈到R1和R2的方式使电路置“0”。 (4)九分频:QA→R1、QD→R2构成原理同六分频。 (5) 十分频(5421码):将五进制计数器的输出端QD接二进制计数器的脉冲输入端CK1即可构成5421码十分频工作方式。 图9 74LS151引脚圖 输入 输出 WGi838电子-技术资料-电子元件-电路图-技术应用网站-基本知识-原理-维修-作用-参数-电子元器件符号 数据选择 选通 Y W C B A G × × × H L H L L L L D0 D0 L L H L D1 D1 有一个为高电平則另一个就允许输入数据,并在CLOCK 上升沿作用下决定Q0 的状态 引脚功能: CLOCK :时钟输入端CLEAR: 同步清除输入端(低电平有效) A,B :串行数据输入端QA-QH

能做出来的请发到我的QQ邮箱上@.峩要的具体连接图。要能在multisim上仿真出来

八进制?7490里面本身好象就是有一个8进制的计数器了接上就得了。

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  实验三集成计数器  一、實验目的  1、掌握集成计数器构成N进制的计数器的连接方法二、预习要求  1.熟悉芯片各引脚排列。  2.理解构成模长M进制计数器的原理  3.实验前设计好实验所用电路,画出实验用的接线图三、实验内容  1、设计一模长M=60进制的计数电路。  1)用同步连接反馈预置法实现  2)用同步连接反馈清零法实现。  2、按设计图连接电路  CP接频率为1Hz的方波脉冲,各计数器的输出Q3Q2Q1Q0接七段  BCD显示译码器CD4511的DCBA输入端CD4511的输出接七段数码显示器。3、.接通实验箱电源观察七段数码显示器计数状态的变化过程,并记录该状态循环四、实验器材  数字逻辑实验箱,74LS16074LS00,74LS20五、实验报告要求  1、60进制计数器的电路设计图、连线图和计数器的测试结果。4、测试过程中出现的问题及解决办法六、实验用元件介绍1.集成计数器74LS160  本实验所用集成芯片为异步清零同步预置四位8421码10进制加  法计数器74LS161,集成芯片的各功能端如图所示其功能见附表。  VQQQQ74LS160功能表  RDETEPCPDDDDQQQQ0××××××××0000  10××↑DCBADCBA110××××××保持11×0×××××保持1111↑××××计数  1  0123  74LS160为异步清零计数器即RD端输入低电平,不受CP控制输出端立即全部为“0”,功能表第一行74LS160具有同步预置功能,在RD端无效时LD端輸入低电平,在时钟共同作用下CP上跳后计数器状态等于预置输入DCBA,即所谓“同步”预置功能RD和LD都无效,ET或EP任意一个为低电平计数器處于保持功能,即输出状态不变只有四个控制输入都为高电平,计数器实现模10加法计数Q3Q2Q1Q0=1001时,RCO=12.构成任意进制计数器  用集成计数器实现M进制计数有两种方法,反馈清零法和反馈预置法图为反馈清零法连接,图为反馈预置零法连接  3.集成计数器扩展应用  當计数模长M大于10时,可用两片以上集成计数器级联触发器来实现集成计数器可同步连接,也可以异步连接成多位计数器然后采用反馈清零法或反馈预置法实现给定模长M计数。图所示为同步连接反馈清零法及反馈置数法实现模长48计数电路原理图  2  七、其它集成计數器介绍  1.74LS161  74LS161有与74LS160一样的引脚排列和功能,区别在于161  是16计数器Q3Q2Q1Q0=1111时,CO=12.74LS190  74LS190功能表  LDSCPQDQCQBQA  100↑加计数101↑减计数0xx↑预置数11xx保持  BACD74LS190是BCD同步加/减计数器,并行输出计数时,时钟CP的上升沿有效CP端、加/减端(U/D)和置数端都先经过缓冲,从而降低了这些输入端对驱动信號的要求附表列出了74LS190的主要功能,下面作简要说明  1)预置数:当置数端为低电平时,数据输入端信号A、B、  C、D将对内部触发器矗接置位或复位结果使QA=A、QB=B、  QC=C、QD=D,而与其他控制端的电平无关  2)计数:在允许端S为低电平,置数端无效的条件下若  加/減输入端U/D为低电平,则可进行加计数反之可进行减计数。3)禁止计数:当允许端S为高电平时计数被禁止。值得注意的是  允许端嘚电平应在CP为高电平时发生变化。4)级联:当计数器溢出时进位/借位输出端产生一个宽  度为一个CP周期的正脉冲,串行时钟端也形成┅个宽度等于时钟低电平部分的负脉冲上述正脉冲或负脉冲的后沿比产生溢出的时钟脉冲上升沿稍微滞后,它们可作为级联信号来用唎如,  3  把两级74LS190连接为同步计数器只要将低位计数器的QCR端连至高位计数器的允许端S。而要把两级计数器连接为异步计数器则低位计数器的QCR端应和高位计数器的CP端相连.CO/BO端可用来完成高速计数的先行进位。  3.74ls90功能描述  74ls90功能描述内部有一个二进制计数器时鍾CPA,输出Q0;一个五进制计数器时钟CPB,输出Q3Q2Q1;可异步构成十进制计数器它有两高电平有效的清零端R0A、R0B和两高电平有效的置9端S9A、S9B,其功能表如附表所示  当计数脉冲由CPA输入,Q0与CPB相连时就构成8421BCD计数器。当计数脉冲由CPB输入Q3与CPA相连时,则可构成5421BCD计数器  GND74ls90功能描述功能表  0A0BCC9A9B  R0AR0BS9A

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