1.获取网卡地址
依次输入windows开始菜单+R--&输入cmd--&输入ipconfig/all
找到本地连接的网卡物理地址并记录，如下图，记录下物理地址00E06F262701。注意，请认准“本地连接”，千万不要选择无线连接。
2.修改license.dat文件
将license.dat内的“HOSTID=”后面的内容，用刚记下的网卡地址替换，文本中有两处要替换，并将其另存到：quartus安装目录\91sp2\quartus中。
3.替换bin文件
将文件夹bin复制到目录quartus安装目录\91sp2\quartus\bin，覆盖掉相应的文件；(注意，bin 32的内容拷到bin目录，bin 64的内容拷到bin64目录，两个都要拷)
4.运行Quartus II
5.指定lincese文件
当询问到license时，选择 "Specify valid license file"，指定到文件：quartus安装目录\91sp2\quartus\license.dat；或者打开quartus，Tools-&License Setup，在弹出窗口中，License file选择quartus安装目录\91sp2\quartus\license.dat。
取消勾选：Use LM_LICENSE_FILE variable
6.检查破解是否成功
Ø打开Quartus II软件后，如果没有关于license的对话框，则说明初步破解成功。
Ø下载明德扬提供的FPGA工程，下载地http://www./bbs/forum.php?mod=viewthread&tid=4
下载到电脑后解压，注意工程路径不要有空格、中文或者特殊字符，直接用Quartus II打开qpf格式的工程，Processing-&Start
Compilation，开始对工程进行编译，如果Quartus II此窗口没有错误提示，则说明破解成功。注意，如果上面窗口有错误提示，则说明破解有问题，请检查步骤1~3，特别是网卡物理地址。<o:p
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FPGA设计开发软件ISE使用技巧之：增量式设计（Incremental Design）技巧
　　6.6 增量式设计(Incremental Design)技巧本文引用地址：
　　本节将对下增量式设计做一个全面的介绍。作为一种现场可编程逻辑器件，其现场可重编程特性能够提高调试速度。每次硬件工程师可以很方便地改变设计，重新进行综合、实现、布局布线，并对整个设计重新编程。
　　然而当设计算法比较复杂时，每一次综合、实现、布局布线需要花很长的时间。即使仅仅改变设计中的一点，也会使综合编译的时间成倍增加。而且更为麻烦的是如果整个工程的运行频率很高，对时序的要求也很严格，这样重新布线往往会造成整个时序错乱。
　　运用增量式设计可以有效地解决这一问题。一方面大大节约综合、布局布线的耗时，另一方面可以继承前一设计中已有的成果，是一种比较常用的设计流程。
　　6.6.1 增量式设计的必要性
　　增量式设计(Incremental Design)方法是一种能在小范围改动情况下节约综合、实现时间并继承以往设计成果的设计手段。作为一个流程，增量设计能够极大地减小布局布线时间，并且当对一个近似完整的设计作小的变动，可以保持整个系统的性能。
　　在增量设计中每一个逻辑分组在Xilinx的里受到约束以使之只占有自己的空间。在设计中，对当对其中之一的逻辑分组做改动时，一个增量设计流程可以确保未做改动的逻辑分组在进行综合输出时不变化。接着布线工具对改动了的逻辑分组重新进行布局布线，而未改动的逻辑分组则继续以前的布局布线结果，这使得整个设计的布局布线时间得以削减。
　　增量式设计对一处复杂的设计来说是非常必要的，主要是因为增量式设计有以下两个方面的优点。
　　1.减小综合、布局布线的耗时
　　当仅对大型设计工程的局部进行改动时，增量设计流程仅仅改动的部分重新编译，如果改动模块的接口设计恰当，将不会影响其余部分的综合与实现结果，布局布线时也只对改动部分重新布线，未改动的部分保持不变，从而节约了整个编译、布局布线与优化的耗时。
　　2.能够很好地继承未修改区域的实现成果
　　这一点对于对时序要求很严格的设计来说是很有用的。如果一个设计经过多次调试，附加合适的约束，设置恰当的参数达到了最佳实现成果。但是因为对某个细节进行了修改，就需要全部重新综合、布局布线，这样可能前面所做的精心调整工作都无效了。
　　通过增量式设计，可以解决这一问题。对于已达到设计要求的部分将其保持不变，仅对修改的部分重新编译、布局布线，从而保证在最大程度上继承以往的实现结果。
　　6.6.2 增量设计流程
　　具体的增量设计流程如图6.29所示。
　　增量设计的流程可归纳如下。
　　1.创建逻辑分组(Create Logic Group)
　　在增量设计中为了实现减小综合、布局布线耗时，极大程度地继承未修改区域的成果，必须要求将设计分成多个逻辑分组。每个逻辑分组应该分配一定的逻辑区域，当某一逻辑分组的内容发生改变时，增量设计可以在该逻辑分组分配的逻辑区域内对其进行重新综合和布局布线，而不会影响到其他的逻辑分组。
　　所谓&逻辑分组&，是惟一的逻辑层次中的若干逻辑实体的划分。比如在顶层逻辑层次中每个子模块即为一个逻辑分组。在代码中即为顶层中&module(Verilog)&和&entity(VHDL)&定义的子模块的实体。在一个设计中往往将实现的不同功能设置为不同的模块，然后在一个顶层模块中实例化所有这些不同功能的模块，从而实现一个完整的功能，那么这些不同功能的模块就可以看作是不同的逻辑分组。
　　在进行逻辑分组时，需要考虑以下因素。
　　(1)设计中所有逻辑除了IOB和时钟逻辑，都应该包含在逻辑分组当中。
　　(2)顶层模块不应该包含复杂逻辑，仅仅包含一些I/O定义、时钟分配逻辑和所有子模块的实例化，直正的功能实体用子模块的逻辑描述。增量设计方法希望将所有的逻辑实体分割到子模块中去，而顶层模块不含任何实际的逻辑功能，以便于做相应的区域约束。
　　顶层包含实际逻辑功能的缺点在于：当顶层改变时，相关的Logic Group的接口将发生变化，从而影响Logic Group的结构，在做编译和布局布线时，会影响增量设计的效能。
　　(3)逻辑模块分组必须以寄存器输出，即用寄存器分割模块。这一点其实不仅仅是增量设计的需求，也是合理划分模块的一个基本要求。
　　如果采用同步时序方式设计电路，用寄存器分割逻辑模块，模块间的接口尽量简单，则时序优化路径集中在同一模块内部而不是模块之间的边界上。这样能够使综合器完整地掌握需要时序优化的路径，从而避免了因一个模块内部改变而通过边界影响到其他模块的时序这种不利于增量设计的情况发生。
　　(4)每个逻辑分组为其附加区域分组约束。
　　2.增量综合(Incremental Synthesis)
　　所谓增量综合是指只有改变的部分重新综合，而对未改变部分保持原有的综合结果的一种综合技术。传统的综合技术即使有微小的改动，也会对整个设计重新综合。
　　如果要实现增量综合必须对综合工具做相应的设置。在这里主要讲述自带综合工具XST是如何实现增量综合的，对于其他综合工具如：Synplify/Synplify Pro和Leonardo Spectrum综合工具，在这里不做详细介绍。
　　XST支持单一工程的模块级增量综合(BLSI)。实现的方法为在XST的约束文件(扩展名为xcf)中附加逻辑分组约束，从而告知XST Logic Group的边界。
　　XST在综合时，所有的编译与优化都不超越用户在XCF文件中约定的Logic Group的边界，以达到在细微修改后仅仅对Logic Group内部进行重新综合的目的。这样一个逻辑分组HDL源代码的改变就不会对其他逻辑分组造成影响。
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我来说两句……
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1. 使用PlanAhead增量编译技术。2. 使用Vivado。同时代的X和A两家技术没有质的差别。
感觉altera虽然快但是综合的结果比较一般
fpga卖的是硬件
都一样慢，编译一边都可以打一把星际了。增量编译好像要收费的，公司小，没钱买。
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FPGA学习笔记（一）新的人生开始&学习的动机及ubuntu13.04上quartusII 13开发环境的搭建
查看次数2191 发表时间 06:39:50
&今天起，开始启动这个计划为期一年半的项目，最终项目目标是在FPGA中验证自己根据OPENRISC设计或者修改的CPU。&&这个项目由我自己独立完成，先说说进行这个项目的动机吧：&&大学前...
&今天起，开始启动这个计划为期一年半的项目，最终项目目标是在FPGA中验证自己根据OPENRISC设计或者修改的CPU。
&&这个项目由我自己独立完成，先说说进行这个项目的动机吧：
&&大学前两年搞了两年的嵌入式，主要是各种单片机，USB、无线通信、RTOS也都搞了一些，当然也包括ARM11以及学了一些LINUX系统操作和内核知识。算是跟着兴趣一路走来，当然也被一些本身不想参加的比赛或项目给束缚，虽然也都学到了东西，但是我觉得在大学里就该有大学的样子，不要为了功利或者其他的事情而放弃自由放弃原则，做自己真正想做的事情，学自己真正想学的东西，而到了社会里就应该有社会该有的样子，肩负更多的家庭社会责任，学会有原则的选择和放弃。所以，现在这个最后一项我参加的比赛--全国电子设计大赛快结尾了，我要开始我的新的人生，一个没有羁绊的大学生涯，踏踏实实、不推脱、不怠慢地开始做我要做的东西，那我要做的到底是什么呢？之前兴趣就是CPU底层、系统内核，现在这仍然是我的兴趣，当然兴趣要考虑与事业进行结合了，这个事业呢，是我作为大学生要履行的对生我养我的祖国人民的事业，而不是传统意义上的金钱事业，这个事业就是芯片事业，没错，我要做数字芯片前端，就从现在开始！
&&我之前一直是认为学习一定要主动学习，主动的探索，这样才能最有效率最有乐趣的学习！技术日新月异，学习探索能力一直是做技术研发的重要技能。但是我现在仅仅有一套FPGA开发板、一台电脑、一些参考书籍、一颗热心和一个还算聪明的头脑，我就要做芯片？很多人觉得痴人说梦，的确，但是这是我现在唯一想做的，其实如果做芯片，还可以考研，但是我承认对自己考研真的是没信心，我这两年我已经忘记了怎么去做题考试了，学习所有科目都是以理解和应用为第一核心，不需要记的就只查书，因为我接触的信息量真的太大，所以说如果走考研的路，风险是很大的，不光是考研录取率，重要的是一个思维方式和态度转变。所以我选择赌一把，用我的努力来获得将来能够在芯片厂家当做研发最底层人员的机会，如果我输了，我无怨无悔，我也为了祖国发展的事业拼搏了一把，年轻就是用来拼的，用现有的技术和能力以及我的不屈不挠的毅力一样可以在别的领域突破！
&&其实一开始开发环境我就给想复杂了，我用的是32位的UBUNTU 13.04，板子是黑金的cycloneII开发板，看了半天官方安装手册《Altera Software Installation and Licensing》，还担心自己不是redhat是不是比较麻烦，后来发现直接从官网下载linux的web免费版/akdlm/software/acdsinst/13.0sp1/232/ib_tar/Quartus-web-13.0.1.232-linux.tar
然后解包安装就行，官网说运行脚本setup.sh，我当时给忘了就直接打开包看见里面有个QuartusSetupWeb-13.0.1.232.run，点开发现直接可以图形界面安装，用默认目录安装到/home/xx下就行，然后在当前普通用户模式下设置环境变量，即在~/.bashrc里加入
export PATH=${PATH}:/&你自己的路径&/altera/13.0sp1/quartus/bin
然后quartus命令直接就能打开软件（如果还是找不到命令的话就注销），打开后先建随便建了个工程，连上我的USB BLASTER（
这里注意!!!（来自）
请大家尽量按照以下步骤进行板子和下载线的上电、下电顺序以防止烧坏FPGA：&
上电顺序：&
1.在FPGA板子断电的情况下，插上JTAG下载线接口&
2.插上USB Blaster或者ByteBlasterII的电缆&
3.插上FPGA板子的电源&
下电顺序：&
1. 断开FPGA板子的电源 &&&&&&&
2.断开USB Blaster或者ByteBlasterII的电缆&
3.断开JTAG下载线接口&
,发现硬件直接识别了，这就是linux内核强大之处啊，我同学64位的win7装了半天才装上，然后我就迫不及待的按照打开黑金的流水灯DEMO点下载，发现怎么下也下不进去啊，但是USB BLASTER也是显示已经连接，电源也正常，这时我去网上查了下USB-Blaster Driver for Linux然后发现altera的官网有这么几句“By default, root is the only user allowed to use these devices. &You must change
the permissions on the ports before you can use the USB-Blaster or USB-Blaster II download cable to program devices with Quartus II software.
You must have system administration (root) privileges to configure the USB-Blaster download cable drivers.”
那我就先进入su权限之后打开quartus来试下,注意这时候.bashrc配置文件不是之前用户文件夹里的而是根目录下的，所以我按照上面的方式也简单跟改了根目录下的环境变量，然后打开quartus再试，果然就下进去了，看着流水灯闪闪泪光让我回想起第一次在51上点亮流水灯的感觉，我的大学人生就要这样继续热血下去！！
不过一直用su权限开发也不是个事，所以还是要把端口更改权限，至于怎么修改呢？
我这个linux小菜鸟正在研究中。。
（未完待续）
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