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运行结果出现错误但是流程图中不显示怎么做到的？
加鞭快马, 积分 247, 距离下一级还需 53 积分
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我在aspen自带的例子中将其初始化又重新运行了一次，反发现出现的好多的错误和警告，但是为什么流程图中都不显示呢？其中有的错误我模拟的时候也出现过但是为什么我的就不行，怎么调整也还是有这个错误？
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重置下再运行试试
&成长值: 20690群组:&
说明流程已经收敛了。
那这样的结果能用不？准确不准确？&
那为什么还有这么多的错误和警告啊？是因为开始运行到这的时候出现了错误，后来因为有循环什么的，最后结束的时候是收敛的？&
加鞭快马, 积分 247, 距离下一级还需 53 积分
加鞭快马, 积分 247, 距离下一级还需 53 积分
说明流程已经收敛了。
那为什么还有这么多的错误和警告啊？是因为开始运行到这的时候出现了错误，后来因为有循环什么的，最后结束的时候是收敛的？
识途老马, 积分 372, 距离下一级还需 628 积分
识途老马, 积分 372, 距离下一级还需 628 积分
说明流程已经收敛了。
那这样的结果能用不？准确不准确？
汗血宝马, 积分 1456, 距离下一级还需 3544 积分
汗血宝马, 积分 1456, 距离下一级还需 3544 积分
这个问题我也出现了，控制面板出现错误，但是流程图不显示，不知道能不能用
汗血宝马, 积分 1171, 距离下一级还需 3829 积分
汗血宝马, 积分 1171, 距离下一级还需 3829 积分
问题没解决呀。也遇到类似问题。很郁闷！！
过河小马, 积分 12, 距离下一级还需 38 积分
过河小马, 积分 12, 距离下一级还需 38 积分
我也是这个问题，但修改显示的错误后，流程反而出错了。。。。。。。
识途老马, 积分 386, 距离下一级还需 614 积分
识途老马, 积分 386, 距离下一级还需 614 积分
“10号反应器无法在给定的迭代次数下收敛&&可能是动力学方程或者物性的错误”
这是报错内容的大致翻译
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验证码输入错误，请重新输入6调试；6.1调试的步骤；对设计电路的调试都是对这个电路在仿真之前、下载到；如果编译出现问题，编译会暂停下来，并用红色字体显；提示，你双击它是无法提示错误位置的，必须找到另外；6.2调试中的问题及其解决方法；程序的调试的目的就是为了发现电路上存在的问题，例；（1）没有标明输入、输出内容，或者少标了，以及输；分的名字和标注的名字不一致等；不会错误，但是输入部分
6.1 调试的步骤
对设计电路的调试都是对这个电路在仿真之前、下载到PLD上运行的必要步骤。创建了一个工程，在工程内新建了一个文件，运用模块把电路搭建出来，保存并进行编译，一个电路设计好后将其封装成一个模块（file?creat/update?create symbol files for current file）然后可利用模块之间的连接来完成总电路。在QuatrusII中进行的编译主要由五个组成部分。他们分别是Analysis&Synthesis、Partiition Merge、Fitter、Assembler、Classic Timing Analyzer五个步骤。在编译时，软件界面上会显示编译进行的状态。五个步骤由前到后一个一个进行，一般只要完成了Analysis&Synthesis就基本能确保电路正确。我还发现在进行Analysis&Synthesis过程中如果有错误，则错误一般发生在该过程编译的49左右。全部完成后，编译栏上显示编译进度为100%，及其各个步骤的编译时间消耗。同时在编译栏上，系统将给出此次编译时发现此次电路上存在的warning，有时候warning还很多，不过放心，不影响电路的功能。
如果编译出现问题，编译会暂停下来，并用红色字体显示出错误所在。双击红色字体会出现会出现错误的位置，可方便将电路修改。修改后再次编译直到没有错误，编译成功。注意，这里有个经验之谈，一旦有错误可能会出现Can't elaborate top-level user hierarchy这个
提示，你双击它是无法提示错误位置的，必须找到另外的错误提示才行。我曾经就是出了个小错误，结果在错误提示中只去关注解决Can't elaborate top-level user hierarchy这一条，完全不懂它的意思，最后把前面真正的错位解决了，这条提示也就自然消失了。
6.2 调试中的问题及其解决方法
程序的调试的目的就是为了发现电路上存在的问题，例如语法上的错误，标注错误，接线错误等。我们在调试程序时，错误是难免的，在这里就其中的一部分问题说一下，方便以后别出类似的错误。
（1） 没有标明输入、输出内容，或者少标了，以及输入、输出部
分的名字和标注的名字不一致等。输出内容少标了只会警告
不会错误，但是输入部分一旦少标注了，那电路将无法运行。
输入的标注寻找input器件，输出的标注寻找output器件。
（2） 接线未能接上，或者器件经过移动后接线出现错误等。
（3） 编译前没有将编译的模块置顶（set as top-level entity），
如果忘记了，可能编译到别的模块。
要想对某个电路图经行仿真，仿真前对相应电路经行编译，确保正确后方可新建Vector Waveform File 文件经行仿真。我一般使用的仿真中的simulator tool经行电路的功能仿真，实验中的相应仿真图
我也在第4章和相应的原理图放在一块了，那样便于老师查看和比较，在这里就不在赘言了。
8 编程下载
8.1编程下载的基本步骤
编程下载就是将已经经过了调试、并且在一定程度上进行了仿真的程序下载到硬件（SMARTSOPC系统）上，将软件同硬件结合起来，使设计的功能得以真正实现过程。
编程下载的过程主要包括以下几个步骤：
（1） 再将编译好的程序下载至芯片之前，进行管脚的分配。
（2） 选择“Assignment―Pins”，在其中对管脚的地址进行下设置。
（3） 选择“File―Save”进行对设置的保存。
（4） 在DEVICE&PIN,将未使用的管脚设置为高阻设置，以免损坏芯
（5） 下载。
9 实验结论与研究展望
将设计程序下载到实验箱上运行调试后，最终结果与预期效果基本一致，时、分、秒能够正常计数并能由控制键分别显示，整点报时功能
正常。但是由于时间关系，没有调出温度显示功能。
在此次的数字钟设计过程中，更进一步地熟悉有关数字电路的知识和具体应用。学会了QuarterII软件进行原理图的绘制，硬件描述语言VHDL的编写，程序的仿真等工作。并能根据仿真结果分析设计的存在的问题和缺陷，从而进行程序的调试和完善。
在设计电路中，往往是先仿真后连接实物图，但有时候仿真和电路连接并不是完全一致的，例如在对具体模块的仿真的过程中，往往没有考虑到整体设计的层面以及与上下模块接口的设计。再加上器件对信号的延时等问题，实际下载到实验箱上后会出现一系列的问题，因此仿真图和电路连接图还是有一定区别的。
此次的数字钟设计重在于按键的控制和各个模块代码的编写，虽然能把键盘接口和各个模块的代码编写出来，并能正常显示，但对于各个模块的优化设计还有一定的缺陷和不足。总的来说，通过这次的设计实验更进一步地增强了实验的动手能力，对数字钟的工作原理也有了更加透彻的理解。在本设计调试过程中遇到了一些问题如下：
1.当程序下载到实验箱上后，数码管显示全部为零，计数器不工作，经分析得知程序中的总的清零信号保持有效状态，改动程序后计数器开始计数。
2.当秒时钟计数到59时变0时，分计数模块滞后计数，考虑的器件的延时，将程序中秒的进位信号提前1秒。
3.在检测按键时，由于有些按键控制是秒时钟同步的，所以控制起
来显得梢慢些，但是工作正常，能满足实际的需要。
本设计中虽然有控制键对时钟进行控制，基本要求已经完成，但是温度显示功能没有实现。
本设计是采用硬件描述语言和FPGA芯片相结合进行的数字钟的研究，从中可以看出EDA技术的发展在一定程度上实现了硬件设计的软件化。设计的过程变的相对简单，容易修改等优点，相信随着电子技术的发展，数字钟的功能会更加多样化，满足人们的各种需要。
[1] 刘君，常明，秦娟，基于硬件描述语言（VHDL）的数字时钟设计，天津理工大学学报，2007，第23卷 第4期，40-41
[2] 廖日坤，CPLD/FPGA嵌入式应用开发技术白金手册，中国电力出版社，8。
[3] 王开军,姜宇柏，面向CPLD/FPGA的VHDL设计,机械工业出版社,。
[4] 赵保经，中国集成电路大全，国防工业出版社,1985。
[5] 高吉祥，电子技术基础实验与课程设计，电子工业出版社，2002。
[6] 吕思忠，数子电路实验与课程设计，哈尔滨工业大学出版社，2001。
包含各类专业文献、应用写作文书、专业论文、文学作品欣赏、外语学习资料、生活休闲娱乐、75精品《电子系统课程设计》报告-具有温度显示功能的数字时钟-定等内容。　
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